英伟达Feynman加速A16与CPO布局,台积电先进制程与封装同步扩产

半导体产业研究 2026-08-17 18:15
英伟达Feynman加速A16与CPO布局,台积电先进制程与封装同步扩产图1


英伟达Feynman加速A16与CPO布局,台积电先进制程与封装同步扩产图2

英伟达Blackwell、Rubin与Feynman平台路线图。图片来源:DIGITIMES

英伟达正在把下一代Feynman平台的供应链准备进一步前置。随着Vera Rubin进入量产与爬坡阶段,供应链已开始为Feynman所需的先进制程、3D堆叠、高带宽存储器和共封装光学(CPO)同步布局。相关产业消息称,Feynman有望采用台积电A16制程,并扩大SoIC 3D堆叠、CoWoS-L与定制HBM的使用。不过,英伟达和台积电尚未正式确认Feynman具体制程与封装组合,因此A16、CoPoS等配置仍应视为供应链预期,而非最终产品规格。

A16成为Feynman潜在关键节点,背面供电瞄准AI高功耗逻辑

台积电A16并非简单的“2纳米缩小版”。官方资料显示,A16结合纳米片晶体管与Super Power Rail背面供电技术,把部分电源网络从晶体管正面移至背面,为信号布线释放更多前端资源,从而提高逻辑密度并改善供电效率。台积电已规划A16于2026年进入生产,定位尤其适合信号布线复杂、供电网络密集的AI与高性能计算芯片。

如果Feynman最终采用A16,其意义不仅是制程节点升级,更是英伟达GPU功耗与互连规模持续扩大后,对供电完整性和晶体管密度提出的新要求。Feynman预计要同时承载更高计算密度、HBM带宽与NVLink互连,因此前端制程、背面供电和后端封装必须协同设计。

SoIC与CoWoS-L同步升级,封装从“承载芯片”转向系统架构

供应链消息显示,台积电正为SoIC、CoWoS-L以及下一代CoPoS等平台提前准备厂务、洁净室和设备。上述扩产节奏与英伟达产品迭代加快直接相关:当GPU、CPU、交换芯片和HBM数量不断增加,单靠传统2.5D互连难以持续满足带宽密度、功耗和封装尺寸要求。

台积电3DFabric体系中,SoIC负责高密度3D芯片堆叠,CoWoS则承担更大规模的逻辑芯片与HBM横向整合。两者结合可把部分逻辑功能先通过SoIC堆叠,再放入CoWoS系统级封装。对Feynman而言,这种“3D×2.5D”结构有助于突破单一光罩尺寸、走线长度和功耗限制,但也同步提高键合良率、热管理、翘曲控制和已知良品晶粒筛选的难度。

NVLink带宽迈向PB/s,光互连从选项变成系统约束

原文援引供应链数据称,Blackwell NVL72整机架NVLink总带宽约130TB/s,Rubin提升至约260TB/s,Rubin Ultra进一步达到约520TB/s,而Feynman世代可能突破1,000TB/s,进入1PB/s级。即便具体数字仍需等待产品正式规格确认,这一方向已经说明AI机架内部的数据移动压力正以比单芯片算力更快的速度上升。

铜互连在更高带宽密度下会面临功耗、距离和信号完整性限制,因此CPO的重要性快速提高。台积电正在推进紧凑型通用光子引擎(COUPE),其核心思路是利用SoIC-X把电子集成电路(EIC)与光子集成电路(PIC)进行3D整合,再进一步与CoWoS结合形成共封装光学,把光电转换从板级或外部模块推进到封装架构内部。

先进封装扩产从“追产能”转向“追产品周期”

供应链称,台积电正加速中国台湾地区先进封装基地的土建、厂务系统、洁净室和设备安装,以缩短产能导入时间。嘉义先进封装园区持续扩张,也反映CoWoS需求仍处于高位。需要注意的是,具体AP7、AP8工程节奏和各厂区对应产品仍以公司最终公告为准。

这轮扩产与过去最大的不同,是客户产品周期正在缩短。英伟达从Blackwell到Rubin、Rubin Ultra再到Feynman持续提高迭代速度,意味着台积电不仅要增加产能,还必须把设备认证、材料验证、工艺窗口和客户产品导入提前。先进封装的投资逻辑正在从“有订单再扩产”,转向“在下一代平台定型前先锁定关键能力”。

资本与供应链同步前置,AI基础设施形成更长链条

除芯片路线外,英伟达也在通过投资和合作强化人工智能基础设施供给。产业资料显示,公司近年在云计算、晶圆制造、网络、光通信等环节持续布局,并与大型金融机构推动AI基础设施融资安排。其核心目的并非单纯扩大财务投资,而是通过资本、GPU供给和数据中心建设形成更紧密的需求闭环。

这种模式会把Feynman带来的需求提前传导至晶圆设备、先进封装设备、载板、光通信、HBM和数据中心基础设施。对设备与材料厂商而言,订单周期因此可能早于GPU正式量产;但同时也更依赖英伟达产品节奏、客户资本开支和台积电扩产执行。

产业观察:Feynman竞争重点将从单颗GPU转向“制程—封装—光互连”协同

Feynman真正值得关注的不是某一项单独规格,而是AI计算平台正在把制程、封装、存储器与光互连绑定为一个整体。A16解决晶体管密度与供电问题,SoIC和CoWoS-L承担高密度异质集成,HBM负责高带宽数据供给,CPO则应对机架内部和芯片间不断上升的数据移动能耗。任何一个环节不能按期量产,都可能成为整个平台的瓶颈。

因此,台积电面临的压力也从“能否提供领先节点”转向“能否按同一节奏交付领先节点与先进封装”。英伟达则需要在性能跃升之外维持供应链可制造性和成本可控性。Feynman若按预期推进,将成为检验AI半导体产业能否把前端制程、3DIC、CPO和超大规模机架协同推向量产的重要节点。

原文标题:Nvidia Feynman pushes TSMC A16 and CPO ramp
原文媒体:DIGITIMES
                 







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