7月18日至20日，第三届 CCF 芯片大会（CCF Chip 2026）盛大召开。作为国内芯片领域规模最大、覆盖全产业链的顶级学术盛会，芯华章在大会现场重磅发布智能验证系统（X-IVS）与智能设计系统（X-IDS）双智能系统，并同步推出 GalaxSim Turbo 3.0 Plus 高速仿真解决方案。
本次发布标志着芯华章在 EDA 2.0 道路上迈出了关键一步。依托成熟的数字验证全流程工具平台，芯华章正式将《EDA 2.0 白皮书》中的开放标准化、自动化智能化、平台化服务化理念，转化为可工程落地的完整产品体系，不仅实现了研发效率的质变，更构建了以“证据闭环”为核心的 Agentic EDA 技术路线。
XEPIC Intelligent System（X-IS）
构建签核级可信Agentic EDA底座
随着 AI 芯片、异构计算和先进 SoC 快速发展，芯片研发正进入高复杂度、高协同阶段，对验证效率和结果可信性提出更高要求。行业需要的不仅是 AI 辅助工具，更是能够理解工程需求、执行验证任务并输出可信结果的智能 EDA 平台。
芯华章是业界极少数通过底层统一覆盖率数据库实现数据全链路联动，并构建起完整数字验证解决方案的 Agentic EDA 平台。芯华章将 AI Agent 深度融入研发流程，通过 EDA 引擎、工程知识与验证数据的闭环协同，真正实现了从设计、验证到分析的自动化智能决策。
本次推出的 XEPIC Intelligent System (X-IS) 系列，正是这套全流程智能体系的核心载体，标志着芯华章正式跨入以可验证AI为核心的 EDA 2.0 时代。
其中，X-IVS 智能验证系统融合 Simulation Agent、Debug Agent 和 Formal Agent，构建覆盖仿真、调试、形式验证的智能验证闭环；X-IDS 智能设计系统则打通算法、软件与硬件 RTL 之间的转换路径，降低硬件设计门槛，具备两大核心创新能力：
依托大语言模型自动修复不可综合C语法，避免人工繁杂手动调整改写；
基于大模型驱动自动化PPA优化，与X-IVS联动形成设计验证闭环：算法模型基于X-IVS GalaxEC HEC Agent进行自动化完备验证，确保优化过程中的功能正确性和验证完备性，同步也可与X-IVS Simulation Agent进行联动，自动化生成Testbench，使用动态验证方法学进行功能验证。
目前，X-IVS已完成多个实际项目验证：
X-IDS在超过100个Benchmark 测试验证中，约96%的测试案例经过自动语法修复后达到可综合且功能正确，在卷积加速器项目中实现LUT数量降低24%。
生态共建：芯华章×无问芯穹联合推出EDA AI一体机
发布现场，芯华章宣布与无问芯穹联合推出 EDA AI 一体化整机解决方案，推动国产算力与国产 EDA 能力深度融合。
该方案以无问芯穹 Mizar 高效推理引擎作为算力底座，结合芯华章 FusionFlex 流程管理平台，打造出支持 Agentic EDA 弹性部署的软硬一体基础设施。
方案具备算力资源的智能动态调度能力，能够有效保障大型芯片设计在智能化验证过程中的算力供给与效率保障，为 AI 芯片和 SoC 项目提供算力与 EDA 工具一体化的可信验证基础设施。
芯华章AI EDA产品以无问芯穹智算一体机为算力底座，为其“EDA 2.0”智能工具提供稳定、高效的多元算力支撑，双方合作立足于产业链协同创新的实际需求。无问芯穹将持续优化算力效能，与芯华章共同推进芯片设计全流程的智能化升级，助力中国半导体产业基础设施能力提升。
X-IVS 与 X-IDS 双智能系统是芯华章《EDA 2.0 白皮书》理念的重要落地。我们不单纯追求 AI 生成能力，而是以‘证据闭环’为核心，将算法设计与优化、仿真、调试、形式化验证工具深度嵌入 AI 工作流，在提升研发效率的同时，守住验证质量、工程可控性和签核可信度。
通过与无问芯穹联合构建国产算力与智能 EDA 协同生态，我们将持续夯实可信验证能力，赋能本土芯片设计企业自主创新 。
