
【内容目录】
一、LogicFolding 与 τ定律:3D 堆叠如何缩短关键路径
二、TSV、TGV 与混合键合:三种工艺平台如何协同
三、TSV 产业链:成熟硅平台的分工与代表企业
四、TGV 产业链:从玻璃原片到封测与 EDA
五、国内外产业进展:成熟量产、导入验证与研发储备
六、结语:三种工艺如何把τ定律的 3D 堆叠思想变成工程系统
【本文涉及的相关企业】
华为、台积电、SK 海力士、美光、三星电子、英特尔、盛合晶微、长江存储、长鑫存储、长电科技、通富微电、华天科技、芯德半导体、奕成科技、云天半导体、佛智芯、三叠纪、彩虹股份、凯盛科技、戈碧迦、东旭光电、大族半导体、帝尔激光、吉华激光、德龙激光、沃格光电、玻芯成、安捷利美维、武汉新创元、芯和半导体、硅芯科技、华大九天、合见工软、行芯科技、康宁、肖特、日电玻璃、旭硝子、小原光学、DISCO、东京精密、通快、乐普科、PLANOPTIK、大日本印刷、Tecnisco、FICT、欣兴电子、景硕科技、日月光、安靠、力成科技、Synopsys、Cadence、Siemens EDA、3D Glass Solutions、Mosaic Microsystems、应用材料、泛林集团等。
一、LogicFolding 与 τ 定律:3D 堆叠如何缩短关键路径
华为于 2026 年 5 月公开提出 τ(Tau)Scaling Law。它把电子系统演进的观察尺度从“器件几何尺寸”扩展到“信息完成一次有效传递所需的时间”。这里的 τ 不是某一种材料或某一道封装工艺,而是一个跨层级优化目标。器件层要降低电阻与寄生电容,电路层要缩短关键布线,芯片层要调整逻辑布局与数据流,系统层则要减少芯片间通信和存储访问的等待。[1]
这一框架与先进封装发生联系,是因为封装已经进入关键路径。芯片之间的距离、垂直互连的位置、供电回路的长度和热量的排出方式,都会改变系统的实际延迟与能效。LogicFolding 所体现的“缩短横向通勤距离”正是这种思路的芯片级表达;但它并不等同于 TGV,也不能由此推断某种玻璃基板已经成为华为的既定产品路线。[1] [2]

图|τ定律的“时间缩微”逻辑:从器件、电路、芯片到系统共同压缩关键路径时间。本文依据华为公开表述进行概念化渲染,不包含企业未公开的产品结构或性能数据。
从本文主题看,τ 定律提供的核心问题是:TSV、TGV 与混合键合能否真正缩短信号、供电和数据访问路径,并在热、良率和测试条件下保持可交付性。 因此,评价先进封装不能只看孔径或材料参数,而要看完整路径的时间、能量与制造代价。
二、TSV、TGV 与混合键合:三种工艺平台如何协同
TSV、TGV 与混合键合经常同时出现在先进封装讨论中,但三者解决的问题不同。
TSV(Through-Silicon Via,硅通孔)负责穿过硅裸片或硅中介层,典型工序包括深硅刻蚀、绝缘/阻挡/种子层沉积、铜填充、化学机械抛光、晶圆减薄、背面显露以及后续 RDL。它是 HBM、多层硅器件堆叠和硅中介层平台的重要垂直通路。
TGV(Through-Glass Via,玻璃通孔)负责穿过玻璃中介层、玻璃芯或玻璃功能器件。其典型链条包括激光改质或成孔、化学蚀刻、侧壁准备、种子层与铜填充、双面 RDL、表面处理及检测。玻璃具有高绝缘性和低损耗潜力,也可能支持较大的面板形态;但玻璃脆性、微裂纹、金属附着、填充空洞、搬运和整包热路径都必须在产品条件下验证。[12] [13] [14]
混合键合(Hybrid Bonding)解决的是相邻晶圆或裸片表面的连接。它以介质—介质和铜—铜直接键合替代部分微凸点连接,从而压缩层间距离和互连间距。混合键合与 TSV 并不天然互斥:在 HBM 或逻辑堆叠中,TSV 可以负责穿过硅片,混合键合则负责相邻层面的接合。[3]

图|TSV、TGV 与混合键合三种工艺平台。依据 IEEE 异构集成路线图、TGV 综述及混合键合公开机制整理重绘。
图 揭示了三者的真正关系:TSV 与 TGV 都包含“成孔—绝缘/种子层—金属化—RDL—组装测试”的连续制造链,只是基材与关键控制点不同;混合键合则位于层与层的界面。一个复杂系统完全可能同时采用 TSV、玻璃芯或玻璃中介层以及混合键合。所谓路线竞争,必须限定在相同层级和相同功能上,而不能笼统写成“玻璃取代硅”或“混合键合取代 TSV”。
三、TSV 产业链:成熟硅平台的分工与代表企业
TSV 已经形成相对成熟的产业生态。它的价值不只是制造一根铜通孔,而是把晶圆工艺、减薄、键合、RDL、封装组装、测试和失效分析连接成一套可重复的平台。表 1 综合产业链分类信息与企业公开资料,并补充证据边界,以便在同一视图中比较企业分工、技术平台和产业状态。
从产业分工看,TSV 生态可以分为四层。第一层是硅晶圆成孔、绝缘和铜填充等中道制造能力。第二层是硅中介层、HBM 堆叠或晶圆级封装平台。第三层是键合、组装、测试和热管理。第四层是设计规则、SI/PI、热分析及客户平台协同。只有四层形成闭环,单孔能力才会转化为稳定的系统产品。

表 1|TSV 产业链与代表企业。国内企业分类及部分平台描述依据行业资料整理;台积电、SK 海力士、美光、三星电子、盛合晶微、长江存储和长鑫存储的状态说明结合企业官方资料。表中研发、路线、验证和量产含义不同。
由此可见,国际 TSV 竞争已经进入平台效率和客户协同阶段。台积电的优势体现在中介层、组装测试和客户设计规则的整合;三大存储厂商则把 TSV、堆叠、热管理和存储芯片设计放在同一产品平台中。国内的确定性进展主要来自硅中介层平台、晶圆级封装和双晶圆键合。长江存储和长鑫存储应被纳入国内存储与三维互连生态观察,但两者目前可公开证明的技术边界不同,不能统一标注为 TSV/HBM 量产企业。
四、TGV 产业链:从玻璃原片到封测与 EDA
TGV 的产业链比“玻璃打孔”更长。上游玻璃原片决定介电、热膨胀和加工基础;激光改质与蚀刻决定孔形貌和损伤;金属化与 RDL 决定电连接能力;封测集成决定大尺寸组装、良率和可靠性;EDA 则需要把玻璃材料特性转化为可用的设计规则。任何一个环节缺失,都可能让材料优势停留在样品阶段。

表 2|国内外 TGV 产业链代表企业与核心能力。依据行业资料与企业公开信息整理。企业名单表示产业角色线索,不等同于已建立客户关系、取得量产资格或获得特定市场份额。
这张表反映出 TGV 的竞争焦点正在从单点成孔向完整交付链转移。玻璃原片企业需要提供稳定的材料窗口,设备企业需要控制微裂纹和孔形貌,TGV 加工企业要把成孔与金属化、RDL 连成连续工艺,封测厂还要解决大尺寸搬运、对准、检测和可靠性。EDA 的作用也因此上升:如果缺少可复用的材料模型、设计规则和失效模型,客户就难以把玻璃平台纳入量产设计。
行业资料将德国PLANOPTIK AG 列为覆盖 Glass-Core-Substrates、Wafer-and-Panel-Level Packaging、Carriers & Tools 的玻璃基板专业厂商,并提到其与英特尔、台积电的合作线索。本文将其作为产业观察,但不直接视为已经认证的供应关系;具体合作范围、项目阶段和时间点仍应由企业公告或技术文件确认。类似地,国内产业链名单说明了参与者正在增加,却不能替代对良率、重复订单和客户认证的核验。
五、国内外产业进展:成熟量产、导入验证与研发储备
当前先进封装产业并不是一条路线依次取代另一条路线,而是三种成熟度同时存在。TSV 已在 HBM、硅中介层和多类晶圆级封装中形成规模化应用;混合键合正从高端逻辑、存储和图像传感器向更多三维集成场景延伸;TGV 与玻璃芯基板则处于功能器件商业化、先进封装导入验证和大尺寸平台研发并行的阶段。

图|国内外 TSV、TGV 与混合键合的产业进展分层。本文依据公开资料与行业资料进行概念化渲染;图中成熟度区域表示证据层级,不表示市场份额,也不承诺具体企业的量产时间。

表 3|国内外产业进展的证据化归纳。研发、样品、客户验证、量产准备、量产和持续出货是不同阶段,不应合并表述。
国内外路线的最大差异,不只在某一个孔能做多小。国际领先平台已经把设计规则、材料、设备、组装测试和客户产品周期绑定在一起,因此竞争重点转向产能、热设计和平台迭代。国内的优势是产业链参与者快速增加,TSV、玻璃材料、激光设备、封测和 EDA 均出现本土供给;短板则在跨环节数据尚未充分连通。下一阶段的关键不是再增加一张样品图,而是形成可追溯的工艺窗口、可靠性数据和重复订单。
从τ 定律的角度看,这一进展最终仍要回到系统收益。如果更复杂的垂直结构缩短了信号路径,却增加了热阻、失效率或测试成本,那么它并没有完成“时间缩微”。能够胜出的方案,应在关键路径、带宽、功耗、供电、散热、良率和合格品成本之间形成可验证的整体改进。
六、结语:三种工艺如何把τ 定律的 3D 堆叠思想变成工程系统
τ 定律对 3D 堆叠提出的真正要求,不是简单增加芯片层数,而是缩短信息完成一次有效传递所需的时间。要实现这一目标,逻辑布局、垂直通路、层间界面和封装载体必须共同优化。TSV、TGV 与混合键合的重要影响,正在于它们分别把 τ 定律的 3D 思想落实到“穿过硅”“穿过玻璃”和“跨越层面”三个工程位置。
TSV 为有源硅裸片、HBM 和硅中介层提供成熟的垂直数据与供电通道。它使三维堆叠不再只是物理叠放,而成为可寻址、可供电、可测试的电气系统。对 LogicFolding 而言,TSV 的意义是把原本较长的横向传输转化为更短的垂直路径;它同时也引入寄生参数、铜应力、减薄和散热约束。因此,TSV 能否降低 τ,取决于关键路径收益是否大于新增的电学、热学和制造代价。
混合键合进一步压缩相邻芯片层面的连接距离。相较依赖微凸点的界面,它有机会减小互连间距、层间高度和界面寄生,使垂直逻辑分区更加接近 LogicFolding 所要求的高密度短路径。它并不取代 TSV,而是与 TSV 共同组成“穿硅通路+层间界面”的三维网络。其影响也不仅是提高堆叠密度,还包括改变芯片分区、缓存位置、供电网络和已知良好芯片策略。
TGV 对 τ 定律的作用位于更外层的封装与系统边界。玻璃中介层或玻璃芯并不直接证明华为 LogicFolding 已采用 TGV,但其低损耗潜力、大尺寸布线空间和可调材料特性,为芯粒之间的数据、时钟和电源路径提供了新的承载方式。当局部逻辑通过 TSV 与混合键合实现垂直折叠后,TGV 可以在适合的系统中承担更大范围的无源互连和扇出,使芯片级“短路径”不会在封装级重新变成长路径。它的价值仍取决于金属化、RDL、散热、翘曲、测试和良率能否同时达标。
因此,τ 定律所指向的 3D 堆叠,不应被理解为某一种通孔或键合技术的胜利,而是TSV 提供垂直骨架、混合键合压缩层间界面、TGV 扩展低损耗封装网络的系统协同。三者共同把“缩短路径”的思想,从逻辑版图推进到芯片堆叠和封装平台。最终判断标准也不是堆了多少层,而是关键路径是否真正缩短,功耗与热是否可控,结构是否可测试,以及系统能否以稳定良率持续交付。只有这些条件同时成立,3D 堆叠才真正转化为 τ 意义上的“时间缩微”。
参考文献:(上下滑动可查看):

